【通訊ic】職缺

工作項目:1.ArchitectureandRTLdesign,FPGAverification2.Synthesis,STA,timingclosure3.SoCintegration應徵條件:1.兩年以上數位IC設計經驗(有 ...

【通訊ic】職缺

工作項目: 1. Architecture and RTL design, FPGA verification 2. Synthesis, STA, timing closure 3. SoC integration 應徵條件: 1. 兩年以上數位IC設計經驗(有 ...

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